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R
Detailed Description
GPIO LED Interface
All LEDs connected to the GPIO lines illuminate green when driven with a logic 0 and
extinguish with a logic 1. Table 2-16 shows the connections for the GPIO LEDs from the
FPGA to the non-inverting buffer (U36).
Table 2-16:
GPIO LED Connection from FPGA to U36
UCF Signal
Name
DBG_LED_0
DBG_LED_1
DBG_LED_2
DBG_LED_3
DBG_LED_4
DBG_LED_5
DBG_LED_6
DBG_LED_7
FPGA Pin (U37)
AF19
AD5
AD6
AD7
AB8
AC7
AC9
AC10
Schematic
Signal Name
DBG_LED_0
DBG_LED_1
DBG_LED_2
DBG_LED_3
DBG_LED_4
DBG_LED_5
DBG_LED_6
DBG_LED_7
LVC244
Buffer (U36)
2
4
6
8
11
13
15
17
LED
DS20
DS19
DS18
DS17
DS16
DS15
DS14
DS13
GPIO LCD Interface
The GPIO LCD interface has eight input/output signals used as data and three output-
only signals used as control. The data signals are controlled by the logic level of the
FPGA_LCD_DIR signal. A logic 1 on FPGA_LCD_DIR configures the LVCC3245 to drive
the J13 header, while a logic 0 on FPGA_LCD_DIR configures the LVCC3245 to drive the
FPGA.
Table 2-17 shows the data bus signals on the GPIO LCD interface from the FPGA to U35.
Table 2-17:
GPIO LCD Data Signals from FPGA to U35
UCF Signal Name
FPGA_LCD_DB0
FPGA_LCD_DB1
FPGA_LCD_DB2
FPGA_LCD_DB3
FPGA_LCD_DB4
FPGA_LCD_DB5
FPGA_LCD_DB6
FPGA_LCD_DB7
FPGA_LCD_DIR
FPGA Pin (U37)
AJ21
AG21
AJ20
AH20
AG20
AK19
AJ19
AH19
AK18
Schematic Signal
Name
FPGA_LCD_DB0
FPGA_LCD_DB1
FPGA_LCD_DB2
FPGA_LCD_DB3
FPGA_LCD_DB4
FPGA_LCD_DB5
FPGA_LCD_DB6
FPGA_LCD_DB7
FPGA_LCD_DIR
LVCC3245
Translator
(U35)
3
4
5
6
7
8
9
10
2
LCD I/F
(J13)
7
8
9
10
11
12
13
14
-
The control signals allow the user to read/write the LCD character display in conjunction
with the eight LCD data signals defined in Table 2-17 . See the AND491GST LCD display
data sheet located on the ML410 documentation CD for more information.
ML410 Embedded Development Platform
UG085 (v1.7.2) December 11, 2008
www.xilinx.com
49
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